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[硬件设计交流] 关于TLSR8258的IIC上拉电阻配置的问题

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英勇黄铜

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发表于 2026-4-28 14:25:26 | 显示全部楼层 |阅读模式 来自 江苏南京
Information
说明:   建议参照本版块置顶帖内容输入必要信息
芯片型号: TLSR8258F1KET48A
一、问题描述:以下描述均是在固件配置为快速模式(400KHz)的情况下,做的测试。
    现象1:使用TLSR8258的硬件IIC,外置4.7K上拉电阻,实际测试发现无法进行通信。
    现象2:将外置上拉电阻由4.7K更改为10K,可以进行通信。
    现象3:将10K的外置上拉电阻去掉,可以进行通信。
    现象4:按照技术手册上的设计规范,外置3.3K上拉电阻,无法进行通信。
    现象5:固件在配置硬件IIC时,找不到开漏模式,只有上拉模式(无法解除芯片内部上拉电阻)。

二、需要帮助解决的问题:
    我需要具体的 “固件配置方案” 和 “外置上拉电阻的配置方案” ,以保证我的产品IIC通信的质量,避免在批量生产时出现问题。

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不屈白银

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发表于 2026-5-7 14:07:58 | 显示全部楼层 来自 上海
你好,我们 GPIO 配置为推挽模式,非开漏模式。开启 IIC 功能后,芯片内部会默认使能 100K或者1M 上拉电阻。规格书推荐 3.3KΩ 上拉阻值,已通过内部多轮测试验证,预期通信无异常。建议抓取 IIC 信号波形,便于定位问题;同时麻烦提供对端设备规格书,可辅助进一步排查分析。
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